ファーウェイが次世代Ascendチップを発表、最高性能のAIクラスターを支える

今週上海で開催されたHuawei Connect 2025イベントで、中国の巨大ハイテク企業は次世代Ascendチップ・シリーズのロードマップを発表した。

基調講演でファーウェイのエリック・シュー副会長は、2025年を「重要な年」と位置づけ、1月のDeepSeek-R1の発表が極めて重要であると強調した。同氏は、「当分の間」半導体プロセス・ノード技術において中国の遅れが予想されることを率直に認めた。

貿易制限に直面する中、ファーウェイはインフラ革新に力を入れる一方、openPangu基盤のAIモデルやMind SDKシリーズなど、重要なソフトウェア資産をオープンソース化している。

アセンドの進化

次期Ascendのラインナップは、3つの新シリーズを特徴とする：950、960、970チップセットだ。

Ascend 950PRと950TOは共通のシリコン・アーキテクチャを採用し、FP8低精度コンピューティング（1 PFLOP）とMXFP8（定格2 PFLOP）のサポートを強化する。各PFLOPは毎秒1兆浮動小数点演算を意味します。

アーキテクチャの改善には、洗練されたベクトル処理と最適化された128バイトのメモリアクセス粒度（512バイトから減少）が含まれます。950シリーズは、2TB/秒の相互接続帯域幅を誇り、現行のAscend 910Cと比較して150%向上しています。発売時期は、950PRが2026年第1四半期、950DTが2026年第4四半期です。

2027年第4四半期に発売されるAscend 960は、演算能力、メモリ帯域幅、容量、相互接続ポートなど、すべての主要指標が倍増する。ファーウェイ独自のHiF4フォーマットが導入され、従来のFP4精度を上回ると謳われている。

フラッグシップモデルのAscend 970（2028年第4四半期）は、「すべての仕様を大幅に向上」させることを目標としており、4TB/秒のインターコネクト、8PFLOPsのFP4性能、メモリ容量の拡大を目標としている。

NPU SuperPods

ファーウェイのハイパースケール・コンピューティング・ソリューションは、2026年第4四半期に950DTチップを搭載したシステムでデビューするAtlas SuperPodsで具体化される。NVIDIAの次期NVL144（2026年）と比較して、ファーウェイはその最初のSuperPodが56.8倍のNPUと約7倍の処理能力を提供し、NVIDIAの予測2027年NVL576に対しても優位性を維持すると主張している。

汎用プロセッサー

Kunpeng 950プロセッサ・ファミリーは2026年第1四半期に登場し、96コア/192スレッドおよび192コア/384スレッドの構成を備えている。同時に、ファーウェイは世界初の汎用SuperPodソリューションとしてTaiShan 950 SuperPodを発表する。

オープンソースの相互接続

次世代SuperPodsはUnifiedBus 2.0を実装し、2023年3月に導入されたAtlas 900 A3の相互接続標準（現在300以上の導入実績）から進化する。オープンプロトコルであるユニファイドバス2.0の仕様は、開発者に同時に公開される。

この技術はSuperPodの内部通信を強化し、SuperClusterの形成を可能にする。最初のAtlas 950 SuperClusterは、xAIのColossusの2.5倍のNPU密度と1.3倍のコンピューティングパワーを上回る。

2027年後半までに、ファーウェイはAtlas 960 SuperClusterを計画しており、4ゼタFLOPS FP4パフォーマンス（1 ZFLOP = 10²¹演算/秒）が可能な100万以上のNPUを統合する。「UnifiedBusを搭載したSuperPodsとSuperClustersは、今日と明日の指数関数的なコンピューティング需要に対応します」と、Xuは締めくくった。

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